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V DD
PWM
Input
Gate Drive
Regulator
Logic and
Dead-time
Adjust
Gate Drive
Supply
LM5113
Gate
Driver
Half-Bridge with Bypass
V IN
OUT
7 V – 12 V
–
V DD Supply
+
Gate Drive Supply
(Note Polarity)
+
V IN V
–
(For E ciency
Measurement)
EPC900 2, 100 VDEVELOPMENTBOARD
Rev. 5.0
eGaN? FET ? EPC 2013
A
I IN
Switch Node
External Circuit
+ < 70 V
V IN Supply
–
Figure 1: Block Diagram of EPC9002 Development Board
PWM Input
POWERCONVERSION
EFFICIENT EPC
Figure 2: Proper Connection and Measurement Setup
EPC900 2, 100 VDEVELOPMENTBOARD
Rev. 5.0
eGaN? FET ? EPC 2013
Do not use probe ground lead
Ground probe
against TP3
Figure 4: Typical Waveforms for V IN = 48 V to 5 V/7 A (500kHz) Buck converter
CH1: Switch node voltage (V SW ) - CH2: PWM input voltage (V PWM )
POWERCONVERSION
EFFICIENT EPC Minimize loop
Figure 3: Proper Measurement of Switch Node – OUT
Place probe in large via at OUT
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